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    接受4位數字並生成其三元組的電路，這是什麼意思？有人能給我一個例子嗎？

    我必須設計一個組合電路，它接受一個4位數並生成它的三元組，這是什麼意思？有人能給我一個具體的輸入和輸出的例子，所以我可以理解這個問題嗎？ 如果你可以給我任何提示設計這個電路，我將非常感激。 謝謝。
    boolean bit boolean-logic circuit 2014-10-07

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    如何在MATLAB中創建框圖和分析一個簡單的RLC電路？

    我有this！ RLC電路簡單 我想分析該電路， ，但我不知道我可以得出一個框圖，並用MATLAB的它抵抗的價值觀不同，我只是搜索互聯網和發現了一些圖書館，但我沒有發現我的工作有什麼特別的地方，請如果你有這方面的經驗分析幫助我，讓我知道我怎麼能用MATLAB分析它simulink 我認爲它非常簡單的電路，如果我找到了一種方法在MATLAB中創建這個，Matlab可以很容易地分析，並且我想分析這個電
    matlab simulink circuit simscape 2014-12-05

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    在RFID中，是否有標籤模塊可以讓用戶選擇不同的輸出？

    我在尋找一個RFID標籤，可以讓您選擇「選擇輸出」。例如，您希望使用具有X方向的多向開關從X個可能的輸出列表中選擇一個RFID輸出。 這樣的事情存在嗎？ X有哪些可用的解決方案？它有多小？ 如果不是，你怎麼能去設計這件事？只需將天線從多個X芯片上滑過所需的芯片，並進行一些去抖動？或者只使用一個芯片，但將X輸入中的一個與另一個電路和去抖動連接起來？ （以及什麼類型的電路？） 此外，如何在不使體積龐大
    microcontroller rfid microprocessors circuit debouncing 2015-05-05

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    具有16位有符號輸入的Verilog計算器

    我需要構建一個計算器，該計算器根據opCode（4位輸入）採用2個有符號16位數（in1，in2）和預形函數。輸出應該是一個名爲'結果'的有符號16位數字和一位'溢出' 我確實需要幫助修復我的代碼。它不工作，我不知道我做錯了什麼。 操作碼 0000 .....添加IN1和IN2 0001 .....減去IN1-IN2 0010 .....鴻溝IN1十有剩餘1或零（使用模運算符） 0011 ....
    verilog xilinx hdl circuit 2015-10-06

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    我可以將5V邏輯應用於xc95288xl的JTAG引腳嗎？

    我設計了一款XC95288xl CPLD板。我用兩個74125緩衝區將並行端口連接到cpld的jtag引腳。 cpld和74125緩衝區均使用3.3V電源。但是我想知道是否可以使用5V來爲緩衝器供電，而使用3.3爲CPLD的I/O引腳供電？ XC9500xl系列數據表說IO端口是5V寬容，但沒有說任何關於JTAG引腳。 我在問這個問題，因爲如果我向緩衝區提供5V電壓，它們將在其引腳上使用5V TT
    fpga xilinx electronics circuit digital-logic 2015-11-26

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    將整數除以3的簡單方法

    我正在研究一個在FPGA上製作簡單音樂播放器的項目。它從PC中獲取指定格式的音樂文件並循環播放。 我們需要實現標準音符長度，即半音節拍的顫音，2拍節奏的最小音符等等。目前我們有一個以不同BPM值的時鐘週期數爲單位的節拍長度表。我們需要將它們乘以這些音符長度以產生正確的時鐘週期。唯一的問題是Tuplet，這是一個完整節拍的三分之一。 無需實現全面的分頻器電路，是否有任何數學技巧一個能做到通過3來劃分
    vhdl boolean-logic circuit 2015-10-08

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    構造一個來自細菌邏輯門的電路

    我有n個輸入和n個相應的輸出，輸出N°i的狀態取決於輸入N°1至n的狀態，EXCEPT N°i。更準確地說，如果除i之外的任何輸入1至n都爲真，則相應的輸出爲真;如果除i之外的所有輸入1至n都爲假，則相應的輸出爲假。 當n變成無限時，是否可以通過基本邏輯門構造這樣的電路？
    logic circuit 2015-07-04

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    如何在ExpressSCH中調整表單大小？

    我已經創建了一個大的原理圖。它大於ExpressSCH中的默認頁面大小。我想調整頁面邊界以適應。你怎麼做到這一點？ 在表單周圍有一個矩形，每個角上都有小方格。我需要調整這個！我猜想你點擊了其中一個小方塊，或者導航菜單來實現這一點，但這不起作用。也沒有網絡搜索的方向。 如何調整頁面大小/更改外部矩形大小？
    circuit 2014-11-04

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    輸出二進制輸入平方的電路設計

    因此，對於我的數字邏輯課程，我們被要求設計一個帶有3個輸入的組合電路和一個產生二進制輸入平方的輸出。我假設她意味着輸入是3位二進制數字0-7。在描述解決方案時，她提到了3個一般步驟1.查找真值表，2.推導函數和3.簡化我很清楚在輸出是單個函數時如何執行此操作（將實例真正的函數，簡化等）。在我們唯一相關的例子中，我們輸入0到9的BCD碼並輸出它們超過3的當量，然後簡化每個4個輸出變量的k映射（W的映
    boolean-logic circuit digital-logic truthtable 2015-06-03

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    Python邏輯電路

    我從視頻中複製這個程序，我認爲AndGate類中的__init__函數是不必要的，因爲AndGate類中沒有新的實例要定義。有人可以證實我的推理嗎？ class LogicGate: def __init__(self,n): self.label = n self.output = None def getLabel(self): ret
    python class oop initialization circuit 2015-04-15
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