fixed-point

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    所以我試圖把我的頭圍繞定點數字。到現在爲止還挺好。唯一讓我困惑的是數字的「分數」部分。 我對定點數的理解是,它根據比例(在這種情況下等於8比特)來分割二進制數。左側是整數部分,分數在右側。 XXX.Y其中XXX是整數/整數部分的三個字節,Y是小數部分的一個字節(請糾正我,如果我錯了)。 讓我們以下面的宏: #define FIX_SCALE 8 #define FIX_FRACTION_MASK

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    假設您有一個帶符號的32位數字,分數長度爲16位。也就是說,前16個MSB是整數部分,其餘(16個LSB)是小數部分。在verilog中有一種方法來顯示這個基數爲10的數字,這使得讀取小數更容易。 例如: 0000 0000 0000 0001 1000 0000 0000 0000應顯示爲1.5 我使用Xillinx。我在網上查找,但我還沒有找到辦法做到這一點。

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    嘗試使用query關鍵字構成固定點查詢時,出現「未知排序」錯誤。例如,下面的例子從固定點的教程,這在Z3的網絡版做工精細, (declare-rel mc (Int Int)) (declare-var n Int) (declare-var m Int) (declare-var p Int) (rule (=> (> m 100) (mc m (- m 10)))) (rule (

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    我認爲我正在過度使用這個probelem,但似乎無法解決這個問題。我正在閱讀文件(範圍(-1,1))中的小尾數浮點數,並且想將它們轉換爲32b定點。 如果我讀取的值爲0xA0C1943B,則相當於浮點數爲0.0045396835。如果我想將它表示爲fixed32_31,那將是0x00129834。 是否有一種簡單的方法在python中從0xA0C1943B獲取到0x00129834?

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    定點數是否包含一個點?如果這樣做,爲什麼它被稱爲一個整數?

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    我正在實現一個VHDL 8位定點乘法模塊,該模塊返回一個8位截斷的數字,但當我手工乘法運算來測試它時,我遇到了一個問題。當我想要乘以兩個負數時出現問題。 我試着乘以兩個正值1.67 * 0.625〜1.04(二進制乘法爲0.906)。 001.10101 -> 1.67 000.10100 -> 0.625 ------------ 000000.1110111010 = 000.11101

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    我做什麼,我認爲是一個很好的fixed-point square root algorithm: template<int64_t M, int64_t P> typename enable_if<M + P == 32, FixedPoint<M, P>>::type sqrt(FixedPoint<M, P> f) { if (f.num == 0) return 0

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    我需要一種方法來計算固定點數B包含到固定點數A中的次數。類似於整數除法,但是是非整數操作數。 我需要爲此操作設計一個硬件塊。 我的第一個猜測是當我到達小數部分時使用除法作爲移位並減去並停止,但也許你知道更好的方法來找到它。

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    我來自VHDL後臺。而在VHDL中,有用於執行固定和浮點運算的IEEE軟件包。它們有時是不可綜合的,但在進行測試時非常有用。 我的問題是,Verilog是否有一個用於執行固定和浮點運算的庫?它不合適,如果它不合成。

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    可以說你必須添加一些存儲在一個巨大的陣列中的32位定點數L,並且你希望得到最準確的結果儘可能的結果。此外,您不得使用除L和32位定點數之外的任何內容(即不允許將它們轉換爲64位)。如何獲得L中數字總和的最準確結果? 這將是我目前的做法在須藤代碼注意: L = sort(L) result = 0 lastMax = false -- indicates whether we've extrac