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    PowerPC e500：任何「頁面全局啓用」標誌等效？

    從英特爾的x86系統編程指南： - （介紹了P6系列處理器） PGE頁全局啓用（位CR4的7） 設置時，啓用全球頁面功能;在清除時禁用全局頁面功能。全局頁面功能允許將經常使用或共享的頁面標記爲全局所有用戶（使用全局標誌位8，在頁面目錄或頁面表項中完成）。全局頁面不會從任務切換器上的翻譯後援緩衝區（TLB）或寫入寄存器CR3中刷新。 PowerPC e500核心系列上是否有任何等效的功能？ 感謝，
    tlb powerpc 2012-06-18

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    虛擬內存系統，頁表和TLB

    我敲我的頭要解決這個問題，甚至無法進行一步到位，問題是這樣的： 考慮下面的C程序： int X[N]; int i; int step = M; // M is some predefined constant for (i = 0; i < N; i += step) X[i] = X[i] + 1; 如果此程序在具有4 KB頁面大小和64條目TLB的計算機上運行，​​則M和N的哪些值
    c caching memory-management virtual-memory tlb 2012-10-02

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    Linux（x86-64）中的多個巨大頁面大小？

    x86-64上的Linux是否支持多頁超大頁面大小（例如，超過4KB基頁大小的2MB和1GB頁面大小）？如果是的話，有沒有一種方法可以爲給定的分配指定使用哪種大頁面大小？換句話說，我的問題是如果在執行mmap()時使用了「MAP_HUGETLB」標誌，它會將它們分配到默認大小的大頁面。無論如何請求分配映射到非默認的巨大頁面大小？
    linux-kernel tlb mmu 2012-05-07

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    OS161：在加載TLB未命中

    當我運行fork測試時，我有一個TLB未命中加載錯誤，我明白這是由於將錯誤的stackptr傳遞給mips_usermode，我的實現似乎圍繞這裏的一些建議，將不勝感激如果我糾正她。我的代碼在thread_fork中作爲入口函數提供。我想念任何事情嗎？ void enter_forked_process(void *junk,unsigned long num) { kprint
    c memory-management mips tlb os161 2012-03-26

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    更改一些MMU翻譯表條目 - 正確的方法？

    更新翻譯表中的條目的步驟是什麼？ 我使用ARM920T的MMU來獲得一些內存保護。 當我在進程之間切換時，我需要更改一些條目以保護其他進程的內存。在更新表（在內存中）後，我發出了一個完整的TLB失效（只是爲了確保，也沒有鎖定的條目），但新進程仍然可以訪問前一個數據。 當我遍歷表時，一切看起來應該是這樣（意味着其他過程區域被設置爲「在USR模式下不可訪問」）。 編輯 我也做TLB無效之前完全緩存清理
    c arm virtual-memory tlb 2012-07-05

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    在Linux內核中處理TLB未命中的調用圖

    我想了解linux內核如何處理TLB未命中。具體來說，我知道頁面表遍歷發生在mm/memory.c的follow_page中，但是當TLB未命中發生時，如何調用follow_page。 follow_page的返回值（struct page）如何傳遞迴硬件？有人可以說明TLB未命中處理的調用圖，從TLB Miss異常由硬件引發到何時調用follow_page？ 我搜索了follow_page裏面的
    memory-management linux-kernel tlb mmu 2012-08-30

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    爲什麼內核向所有其他處理器發送一個tlb無效中斷，當頁表修改爲個人運行時進程

    當一個進程的頁表項進入時，內核線程向所有其他處理器發出擊落中斷，使所有其他處理器無效其他處理器上的tlbs？但是，是不是這樣，頁表是特定於這個過程的，爲什麼我們應該去拍攝一個tlb？
    linux-kernel kernel tlb multiprocessor 2012-05-23

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    使用英特爾PEBS的DTLB未命中地址跟蹤

    我想通過使用硬件性能計數器來生成D-TLB未命中的地址跟蹤。英特爾處理器具有「精確的基於事件的採樣」（PEBS），可在每次採樣時轉儲硬件寄存器內容。我需要使用此寄存器轉儲來創建導致D-TLB未命中的地址。但是，我不確定如何從寄存器轉儲中生成訪問地址。 有人在做類似的事情方面有一些經驗，可以給我一些指導嗎？ 感謝 阿爾卡
    linux performancecounter perfmon tlb perf 2012-08-31

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    MIPS R4000：爲什麼每個EntryLo寄存器都有一個全局位？

    頁以下R4000文檔81： http://www.scribd.com/doc/53181649/70/EntryLo0-2-and-EntryLo1-3-Registers 顯示每個TLB項中一個全局位（這是有道理的）。如果在TLB條目中設置全局位，則在查找過程中將忽略ASID。 但是，在下一頁中，EntryHi寄存器具有保留（0）字段來代替TLB條目的全局位（如第82頁上的標題所述）。取而代之
    mips tlb 2012-09-11

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    有效地址的時間

    我目前正在對OS的一些項目，我知道怎麼找吃單級分頁是 EAT = (MAT+TLB-AT)*a+(2*MAT+TLB-AT)*(1-a) 其中 MAT is memory access time, TLB-AT is TLB hit time a is hit ratio 我我試圖在兩個級別上找出EAT，如果TLB未命中或四次，它會訪問3次內存，任何幫助都將有所幫助。提前致謝。
    caching operating-system paging virtual-memory tlb 2012-06-13
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